Проектирование устройства сбора данных — страница 3

  • Просмотров 2346
  • Скачиваний 207
  • Размер файла 161
    Кб

заблокировано. При ВК=0 обращение разрешается. Для адресации двух линеек требуется адрес из одного бита (0,1). Так как число линеек в ОЗУ не больше двух, то дешифратор не требуется. Биты адресов линеек размещаются в старших разрядах заданного адресного слова. Шестнадцатиразрядное адресное слово позволяет адресовать максимально 216=65536=64к ячеек памяти. Обычно эти адреса распределяются между ОЗУ, ПЗУ и УВВ, входящими в состав

цифровой системы. Если заданное число ячеек ОЗУ меньше, то для их адресации может потребоваться адресное слово с меньшим числом разрядов. В этом случае для адресации ячеек ОЗУ задействуются не все разряды адресного слова заданной длины (2 байта). Будем считать что в таком варианте старшие разряды остаются незадействованными, поэтому их содержимое может быть произвольным, ибо оно игнорируется дешифратором адреса ОЗУ. Однако при

фиксированной разрядности адресного регистра из методических соображений при программировании процессорного устройства целесообразно загружать нули в незадействованные разряды адресного слова. Режим обращение к ОП определяется значением управляющего сигнала ЧТЕНИЕ/ЗАПИСЬ (ЧТ/ЗП) (по ГОСТ - RD/WR). При ЧТ/ЗП=1 обеспечивается режим чтения информации из ОП, при ЧТ/ЗП=0 - режим записи в ОП. Опираясь на выше сказанное построим схему

ОЗУ с емкостью 2к х 8 (рис.1). . . . . . . от УУ · . . . · · . . . . . . O O · · O · o O 1 1 ¤ . . . . . . . . . . . . 8 8 1 1 ___ ___ ___ ___ 10 10 A 0 à 1 2 . . RAM . 9 D0 DI WR / RD CS ШД 8 ША 16 A 0 à 1 2 . . RAM . 9 D0 DI WR / RD CS A 0 à 1 2 . . RAM . 9 D0 DI WR / RD CS A 0 à 1 2 . . RAM . 9 D0 DI WR / RD CS Организация ОЗУ Ёмкость ОЗУ: 2к х 8 = 2048 х 8. Требуется организация двух линеек по восемь микросхем КР565РУ2А . ¤ ¤ Рис.1 4. УСД НА ПРИНЦИПАХ СХЕМНОЙ ЛОГИКИ 4.1 структурная схема УСД Как и всякое процессорное устройство, УСД состоит из

двух основных узлов: операционного узла (ОУ) и узла управления (УУ), который представляет собой микропрограммный автомат (рис.2.). ОУ - это устройство, в котором непосредственно выполняются операции, реализуемые процессором. Этот узел преобразует коды (операнды), поступающие на входы Р в те или иные детерминированные моменты времени, в выходной код (результат), снимаемый с выходов С. В нашем примере на входы ОУ поступают данные с

выхода АЦП, представленные в виде параллельного двоичного кода, а преобразование, осуществляемое в ОУ УСД, состоит в приеме этих данных из того или иного аналогового канала и пересылки их в требуемые ячейки оперативной памяти. ОУ может включать в себя такие элементы, как регистры или иные модули ЗУ, счетчики, сумматоры, мультиплексоры, дешифраторы и др., соединенные между собой каналами связи (обычно физическими линиями), по